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高級(jí)模擬IC設(shè)計(jì)工程師

發(fā)布時(shí)間:2018-7-12 13:19    發(fā)布者:KT咨詢
關(guān)鍵詞: analog , design
NO.470-【獵頭職位:武漢需要一位  高級(jí)模擬IC設(shè)計(jì)工程師】聯(lián)系人:Raymond-Chen,郵箱:hr@kthr.com,微信也可查詢職位了!打開(kāi)手機(jī)微信,搜號(hào)碼“KTHR_COM”或查找微信公眾帳號(hào)“KT人才”或掃描以上二維碼即可添加,歡迎大家關(guān)注!
崗位職責(zé):
1、直接參與55到14納米高速混合電路如DDR3, USB3, PCIe3、HMDI、MIPI,pipeling ADC等、高清多媒體和加密RFID等先進(jìn)芯片的開(kāi)發(fā)、流片與推廣;
2、根據(jù)公司的項(xiàng)目需求主要負(fù)責(zé)55到14納米數(shù)模混合IC和IP的研發(fā),特別是模擬電路的前后端設(shè)計(jì)、仿真、測(cè)試和系統(tǒng)驗(yàn)證的相關(guān)工作;
3、芯片模擬和射頻電路設(shè)計(jì),含high speed transceiver,PLL ,CDR、ADC,DAC等;
4、在芯片開(kāi)發(fā)過(guò)程中指導(dǎo)協(xié)助版圖工程師進(jìn)行版圖設(shè)計(jì)并編寫(xiě)相關(guān)技術(shù)文檔。
崗位要求:
1、微電子/半導(dǎo)體及相關(guān)專業(yè),研究生及以上學(xué)歷;
2、具備扎實(shí)的模擬電路設(shè)計(jì)、理解SI and PI的分析,驗(yàn)證基礎(chǔ)及對(duì)透徹理解高速電路理論知識(shí);
3、熟悉常用模塊(如運(yùn)放,比較器,帶隙基準(zhǔn),振蕩器, pll,DLL,VLSI高速時(shí)鐘電路等)的設(shè)計(jì)、前后端分析和驗(yàn)證方法;
4、2年以上實(shí)際模擬IC電路設(shè)計(jì)和仿真經(jīng)驗(yàn),擅長(zhǎng)考慮非理想條件下的模擬設(shè)計(jì)和VLSI電路分析,對(duì)post layout分析和時(shí)序理解有一定要求;
(具備以下條件優(yōu)先考慮)
5、深刻理解電路的基本原理和物理特性,熟悉Cadence/HSPICE等仿真工具及EDA開(kāi)發(fā)工具,能聯(lián)系理論到實(shí)踐;
6、能系統(tǒng)把握并有過(guò)獨(dú)立設(shè)計(jì)IC產(chǎn)品經(jīng)驗(yàn)并能review 版圖和后仿真;
7、具備IC項(xiàng)目開(kāi)發(fā)協(xié)調(diào)管理能力。
福利:五險(xiǎn)一金  帶薪年假 績(jī)效獎(jiǎng)金 年終獎(jiǎng)金 節(jié)日福利

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