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其實無論用簡單的protel或者復雜的cadence工具，硬件設計大環節是一樣的（protel上的操作類似windwos，是post-command型的；而cadence的產品concept & allegro是pre-command型的，用慣了protel，突然轉向cadence的工具，會不習慣就是這個原因）。設計大環節都要有1）原理圖設計。2）pcb設計。3）制作BOM表。現在簡要談一下設計流程（步驟）：
1）原理圖庫建立。要將一個新元件擺放在原理圖上，我們必須得建立改元件的庫。庫中主要定義了該新元件的管腳定義及其屬性，并且以具體的圖形形式來代表（我們常常看到的是一個矩形（代表其ICBODY），周圍許多短線（代表IC管腳））。protel創建庫及其簡單，而且因為用的人多，許多元件都能找到現成的庫，這一點對使用者極為方便。應搞清楚ic body，ic pins，input pin，output pin， analog pin， digital pin， powerpin等區別。
2）有了充足的庫之后，就可以在原理圖上畫圖了，按照datasheet和系統設計的要求，通過wire把相關元件連接起來。在相關的地方添加line和text注釋。wire和line的區別在于，前者有電氣屬性，后者沒有。wire適用于連接相同網絡，line適用于注釋圖形。這個時候，應搞清一些基本概念，如：wire，line，bus，part，footprint，等等。
3）做完這一步，我們就可以生成netlist了，這個netlist是原理圖與pcb之間的橋梁。原理圖是我們能認知的形式，電腦要將其轉化為pcb，就必須將原理圖轉化它認識的形式netlist，然后再處理、轉化為pcb。
4）得到netlist，馬上畫pcb？別急，先做ERC先。ERC是電氣規則檢查的縮寫。它能對一些原理圖基本的設計錯誤進行排查，如多個output接在一起等問題。（但是一定要仔細檢查自己的原理圖，不能過分依賴工具，畢竟工具并不能明白你的系統，它只是純粹地根據一些基本規則排查。）
5）從netlist得到了pcb，一堆密密麻麻的元件，和數不清的飛線是不是讓你嚇了一跳？呵呵，別急還得慢慢來。
6）確定板框大小。在keepout區（或mechanic區）畫個板框，這將限制了你布線的區域。需要根據需求好考慮板長，板寬（有時，還得考慮板厚）。當然了，疊層也得考慮好。（疊層的意思就是，板層有幾層，怎么應用，比如板總共4層，頂層走信號，中間第一層鋪電源，中間第二層鋪地，底層走信號）。
7）to be continued...... |
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發表于 2008-12-29 16:40:50
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