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模擬芯片設(shè)計(jì)工程師(高速/低速 ADC DAC、PLL、Serdes、IO等)

發(fā)布時(shí)間:2022-3-24 14:21    發(fā)布者:KT咨詢
NO.573-【獵頭職位:上海需要一位   模擬芯片設(shè)計(jì)工程師(高速/低速 ADC DAC、PLL、Serdes、IO等)】 聯(lián)系人:Taurus-Li,郵箱:hr@kthr.com,微信也可查詢職位了!打開手機(jī)微信,搜號碼“KTHR_COM”或查找微信公眾帳號“KT人才”或掃描以上二維碼即可添加,歡迎大家關(guān)注!
崗位職責(zé):
1、參與制定芯片和模塊的Specification;
2、模擬和混合信號 IC 電路的設(shè)計(jì)和仿真
3、負(fù)責(zé)與版圖工程師溝通并完成電路的版圖設(shè)計(jì);
4、制定芯片模塊的測試計(jì)劃,并在流片后配合芯片調(diào)試及測試;
5、負(fù)責(zé)芯片設(shè)計(jì)過程中相關(guān)設(shè)計(jì)文檔的編寫。
崗位要求:
1、3 年以上模擬設(shè)計(jì)經(jīng)驗(yàn),掌握模擬電路基礎(chǔ)知識(shí);
2、了解常見的模擬電路(PLL,SerDes,Opamp,Bandgap,ADC,DAC )等;
3、學(xué)習(xí)能力強(qiáng),喜歡挑戰(zhàn),有團(tuán)隊(duì)合作精神和獨(dú)立解決問題能力,有責(zé)任心;
4、電子類相關(guān)專業(yè)碩士或以上學(xué)位,有產(chǎn)品經(jīng)驗(yàn)優(yōu)先。
福利:五險(xiǎn)一金   

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