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基于ZYNQ+DSP平臺(tái)Zynq7035/45 PL端高速串行接口的千兆以太網(wǎng)UDP例程設(shè)計(jì)和使用說(shuō)明

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發(fā)表于 2022-1-14 11:58:13 | 只看該作者 |只看大圖 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
關(guān)鍵詞: UPC , XC7Z035 , XC7Z045 , 光口 , PCIe
1、例程目的
  基于廣州星嵌電子ZYNQ+DSP開發(fā)板的Zynq7035/45 PL端高速串行接口,使用千兆以太網(wǎng)通訊方式來(lái)測(cè)試驗(yàn)證底板上的光口通信,實(shí)現(xiàn)以下以太網(wǎng)功能:
1 支持IP、UDP協(xié)議,實(shí)現(xiàn)UDP數(shù)據(jù)收發(fā);
2 支持ARP、ICMP協(xié)議,實(shí)現(xiàn)PING功能。
2、例程設(shè)計(jì)框圖
圖1例程設(shè)計(jì)框圖

1
時(shí)鐘管理單元
為例程提供時(shí)鐘源;
2
基于高速串行接口的千兆以太網(wǎng)PHY
以太網(wǎng)PHY,本地為GMII接口,對(duì)外是高速串行接口,可對(duì)接光口轉(zhuǎn)RJ45模塊,連接到外部以太網(wǎng);
3
時(shí)鐘域切換模塊
gmii接收數(shù)據(jù)時(shí)鐘域切換,ping功能模塊收發(fā)數(shù)據(jù)要求在同一個(gè)時(shí)鐘域;
4
Ping功能模塊
支持ARPICMP協(xié)議,實(shí)現(xiàn)以太網(wǎng)PING功能;
5
UDP功能模塊
支持IPUDP協(xié)議,實(shí)現(xiàn)UDP數(shù)據(jù)收發(fā)功能;
6
MUX復(fù)用器
ping功能模塊和UDP功能模塊各自gmii發(fā)送數(shù)據(jù)復(fù)用輸出;
7
PHY復(fù)位模塊
以太網(wǎng)PHY復(fù)位控制;

3、例程文件結(jié)構(gòu)
圖2例程文件結(jié)構(gòu)
4、例程使用說(shuō)明4.1硬件連接
1)使用PCIE供電,連接FPGA JTAG下載線至JTAG調(diào)試口,將高速串行接口轉(zhuǎn)RJ45模塊插入光口籠子里面,并用千兆網(wǎng)線連接至PC電腦:


2)打開電源開關(guān)。

4.2測(cè)試
1)本地MAC和IP地址:
2)測(cè)試環(huán)境:


3)同時(shí)進(jìn)行ping操作和UDP數(shù)據(jù)收發(fā)功能正常:


(以上實(shí)驗(yàn)數(shù)據(jù)基于廣州星嵌電子ZYNQ7035/7045開發(fā)板測(cè)試結(jié)果)



5、開發(fā)平臺(tái)說(shuō)明5.1、供電
USB TYPE-C/PCIe供電,12V@4A

5.2、硬件資源
1、表 1評(píng)估板硬件參數(shù)
DSP
處理器型號(hào)TI TMS320C6657,2核C66x,主頻1.25GHz
Zynq
Xilinx XC7Z035/XC7Z045-2FFG676I
2x ARM Cortex-A9,主頻 800MHz(-2)/1GHz(-3),2.5DMIPS/MHz
1x Kintex-7 架構(gòu)可編程邏輯資源
MAX10型號(hào)10M02SCM153
FLASH
DSP SPI Flash:32MByte
FPGA SPI Flash:64MByte
EEPROM
AT24C1024BN-SH-T
DDR3
DSP DDR3:1GBytes
ZYNQ DDR3:1GBytes(PS端)
溫度傳感器
TMP102AIDRLT
CameraLink
支持2路Base輸入、或者2路Base輸出、或者1路Full 輸入或輸出
SFP+
1路支持萬(wàn)兆光模塊
千兆網(wǎng)口
DSP 1路
ZYNQ PS 1路
PCIe
1x PCIe 雙通道 (DSP端)
SD
1x Micro SD
USB
1x USB 3.0;1x USB 2.0
IO
1x 50pin
M.2
1x 可接SATA、NVME SSD、4G、5G模塊
1x HDMI OUT (PL端)
觸摸屏接口
1xUSB
音頻
1x LINE IN
1x MIC IN
1x LINE OUT
LPC FMC
1路
電源接口
1x TYPE-C接口 12V@4A
標(biāo)準(zhǔn)PCIe供電

5.3 開發(fā)資料
序號(hào)
                                            提供資料
1
核心板引腳定義說(shuō)明;
2
可編輯底板原理圖、可編輯底板PCB、芯片Datasheet;
3
提供Zynq與DSP通過(guò)SRIO、EMIF16、SPI等相關(guān)通訊例程;
4
提供豐富的Demo程序,包含ZYNQ+DSP多核通信教程,完美解決多核開發(fā)瓶頸;
5
提供完整的平臺(tái)開發(fā)包、入門教程,節(jié)省軟件整理時(shí)間。

5.4開發(fā)例程
1)算法開發(fā)例程
2)NonOS開發(fā)例程
3)SYS/BIOS開發(fā)例程
4)多核開發(fā)例程
5)ZYNQ PL開發(fā)例程
6)ZYNQ PS(ARM)開發(fā)例程

5.5增值服務(wù)
1)主板定制設(shè)計(jì)
2)核心板定制設(shè)計(jì)
3)嵌入式軟件開發(fā)
4)項(xiàng)目合作開發(fā)
5)技術(shù)培訓(xùn)

6、聯(lián)系交流
電子郵箱:958481537@qq.com
星嵌官網(wǎng):www.xines.cn
線上商城:https://xines.taobao.com
DSP交流群:536309815
FPGA交流群:858454424
公眾號(hào):星嵌電子
TI官網(wǎng):www.ti.com
TI E2E 中文設(shè)計(jì)支持論壇:https://e2echina.ti.com
Xilinx官網(wǎng):www.xilinx.com
Xilinx論壇:https://forums.xilinx.com
Xilinx WIKI:http://www.wiki.xilinx.com

3.png (1.52 MB)

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鐵蛋底板資源說(shuō)明繪圖.jpg (2.19 MB)

鐵蛋底板資源說(shuō)明繪圖.jpg

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圖片6-2.png
沙發(fā)
發(fā)表于 2022-6-7 13:47:19 | 只看該作者
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