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Altera公司14日演示了使用FPGA的浮點DSP新設計流程，這是業界第一款基于模型的浮點設計工具，支持在FPGA中實現復數浮點DSP算法。伯克萊設計技術公司 (Berkeley Design Technology, Inc, BDTI) 進行的獨立分析驗證了能夠在Altera 的Stratix和Arria FPGA系列中簡單方便的高效實現高性能浮點DSP設計。 Altera浮點DSP設計流程包括集成在DSP Builder高級模塊庫中的Altera浮點DSP編譯器、Quartus II RTL工具鏈、ModelSim仿真器，以及MathWorks MATLAB和Simulink工具，簡化了FPGA的DSP算法實現過程。浮點設計流程結合并集成了算法模型和仿真、RTL產生、綜合、布局布線以及設計驗證級等。通過功能集成，在算法級和FPGA級實現了快速開發和設計空間管理，最終減少了在設計上的投入。 Altera產品和企業市場副總裁Vince Hu評論說：“使用Altera高級DSP基于模型的流程，與基于HDL的傳統設計相比，設計人員能夠更高效迅速的實現并驗證復數浮點算法。在高層對算法進行建模并調試后，很容易面向所有Altera FPGA對設計進行綜合。” Altera新的設計流程適用于解決要求較高的線性代數問題，這類問題一般需要浮點提供的動態范圍。BDTI測試了可參數賦值的浮點矩陣求逆設計。矩陣求逆是雷達系統、MIMO無線系統以及醫療成像和很多其他DSP應用所使用的代表性處理功能。 在評估Altera的浮點設計流程時，獨立技術分析公司BDTI認為：“浮點編譯器并沒有構建由基本浮點算子組成的數據通路，而是產生融合數據通路，在一個函數或者數據通路中組合了基本算子。這樣，避免了傳統浮點FPGA設計中的重復表示。” BDTI結論：“采用融合數據通路方法，與以前相比，實現的復數浮點數據通路性能更好，效率更高。” 請訪問www.altera.com.cn/floatingpoint，閱讀BDTI完整的FPGA浮點DSP設計流程分析報告。 |
