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Achronix與Mentor攜手帶來(lái)高等級(jí)邏輯綜合(HLS)與FPGA技術(shù)之間的連接

發(fā)布時(shí)間:2018-8-30 11:07    發(fā)布者:eechina
關(guān)鍵詞: Catapult , Speedcore , eFPGA , 嵌入式FPGA
Achronix半導(dǎo)體公司(Achronix Semiconductor Corporation)日前宣布:該公司FPGA技術(shù)系列產(chǎn)品已獲得其合作伙伴、西門子旗下的Mentor公司的支持,為其提供優(yōu)化的高等級(jí)邏輯綜合(HLS)流程。

該集成開(kāi)發(fā)環(huán)境使設(shè)計(jì)人員能夠使用Mentor的Catapult HLS和Achronix的ACE設(shè)計(jì)工具快速的用C ++實(shí)現(xiàn)FPGA設(shè)計(jì)。此項(xiàng)合作首先已可用于5G無(wú)線應(yīng)用,以減少整體開(kāi)發(fā)工作并提高結(jié)果的質(zhì)量(QoR),它適用于任何面向Achronix技術(shù)的設(shè)計(jì)。

“Mentor功能強(qiáng)大的Catapult工具和Achronix的嵌入式FPGA技術(shù)結(jié)合在一起,可為那些其SoC設(shè)計(jì)需要高性能FPGA技術(shù)的公司提供了真正獨(dú)到的價(jià)值組合,而這些SoC可以使用經(jīng)過(guò)驗(yàn)證的、基于C語(yǔ)言的設(shè)計(jì)流程來(lái)進(jìn)行配置,”Achronix負(fù)責(zé)市場(chǎng)營(yíng)銷的副總裁Steve Mensor評(píng)論道。 “這種組合型解決方案很好地證明了Mentor和Achronix工程團(tuán)隊(duì)之間的緊密合作關(guān)系。 我們首先面向的目標(biāo)應(yīng)用是5G無(wú)線,但是在其他許多需要最快開(kāi)發(fā)時(shí)間的細(xì)分市場(chǎng)應(yīng)用中,這項(xiàng)整體解決方案的獨(dú)特功能都有其價(jià)值。“

“我們高興地歡迎Achronix加入Mentor OpenDoor計(jì)劃,并樂(lè)于成為Achronix合作伙伴計(jì)劃的活躍成員。 這種開(kāi)放且相互配合的合作伙伴關(guān)系具有非常高的戰(zhàn)略意義,并已經(jīng)被證明是有益于我們的共同客戶,“Mentor公司Calypto Systems業(yè)務(wù)部市場(chǎng)營(yíng)銷總監(jiān)Ellie Burns說(shuō)到。 “Achronix eFPGA提供了極強(qiáng)大的功能,它能夠適應(yīng)一款具有現(xiàn)場(chǎng)可編程能力的SoC的后期變化和新要求。 再加上Catapult HLS和C ++的驗(yàn)證速度,芯片設(shè)計(jì)人員現(xiàn)在可以在幾天而不是幾周或幾個(gè)月內(nèi)輕松地從算法更改轉(zhuǎn)化為全新的低功耗、高性能硬件。“

將Catapult添加到Achronix設(shè)計(jì)流程

將Catapult HLS添加到Speedcore嵌入式FPGA技術(shù)設(shè)計(jì)流程,可使設(shè)計(jì)人員能夠在IP開(kāi)發(fā)的后期階段進(jìn)行算法更改,并優(yōu)化算法和數(shù)字微架構(gòu)。 集成化的驗(yàn)證環(huán)境支持為已生成寄存器傳輸級(jí)(RTL)的代碼去重用軟件測(cè)試,從而將對(duì)專用RTL測(cè)試臺(tái)的需求減少80%以上。

Achronix ACE設(shè)計(jì)工具支持Catapult的RTL構(gòu)造和原生語(yǔ)句。 目前,用于Achronix的Speedcore eFPGA產(chǎn)品及其Speedster獨(dú)立FPGA芯片的Achronix邏輯庫(kù)已被集成到流程中。

Achronix的高性能和高密度FPGA技術(shù)可用于數(shù)據(jù)中心計(jì)算、網(wǎng)絡(luò)和存儲(chǔ)中的各種硬件加速應(yīng)用,5G無(wú)線基礎(chǔ)設(shè)施及網(wǎng)絡(luò)加速,先進(jìn)駕駛員輔助系統(tǒng)(ADAS)和自動(dòng)駕駛汽車。

供貨


該設(shè)計(jì)和開(kāi)發(fā)環(huán)境的早期版本現(xiàn)已上市。
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