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[提問] cpld fpga中的io口問題?

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樓主
發表于 2011-2-10 16:49:14 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
2積分
在設計中,用到一組90個數字量的輸入 輸出,選擇一片144管腳的CPLD,但是不用的IO口我應該怎么處理?
請高手指點 .

沙發
發表于 2011-2-16 14:01:23 | 只看該作者
在q2里設置引腳狀態為你自己想要的狀態,接地或懸空
板凳
發表于 2011-2-17 11:26:56 | 只看該作者
接地或者高阻
地板
發表于 2011-2-20 17:27:44 | 只看該作者
學習中……
地下室
發表于 2011-2-21 00:08:30 | 只看該作者
未使用的管腳可以設置為上拉、下拉、高阻。
具體的是:如果是xilinx的,右鍵單擊Generate Programming File,選property,在cofigration options項中,設置Unused IOB Pins即可(pullup pulldown float三種設置)
如果是altera的,在setting對話框中,選device項,在右側按device and pin options
按鈕,選unused pins項,里面的選項要比xilinx的多,但大體是上拉、下拉、高阻等。
我一般在工程中都選高阻。即ise中用float,quatus中tristate input
注意這些未用的管腳和電路板其他信號是否有鏈接關系,如果有就要考慮其電平狀態了。
6
 樓主| 發表于 2011-2-21 17:16:46 | 只看該作者
在QII中 將不用的IO口設置為三態就可以了。。
7
發表于 2011-3-9 21:00:37 | 只看該作者
學習了
8
發表于 2011-3-10 12:39:28 | 只看該作者
不用的pin最好設置成高阻,這樣比上拉下拉都保險
9
發表于 2011-3-24 09:34:59 | 只看該作者
設置成三態,或者輸入,軟件里面有選項
10
發表于 2011-3-25 22:11:44 | 只看該作者
學習下
11
發表于 2013-3-19 16:49:33 | 只看該作者
學習下
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