1 ModelSimSE的使用流程 2 一個Verilog計數(shù)器仿真詳細流程附源代碼 3 一個VHDL計數(shù)器仿真詳細流程附源代碼 4 Force和run兩個cmd指令詳細解釋 5 Do文件的使用和編寫例子 6 網(wǎng)上下載ModelSimXE調試Verilog TestBench的一個例子 ![]() ![]() ![]() |
謝謝 |
好看看 |
謝謝樓主 |
謝謝樓主 |
xiexie |
謝謝 |
謝謝 |
好東西,支持 |
好東西,支持 |
學習了,多謝 |
學習了,多謝 |
好看看 |
謝了~ |
學習了,多謝 |
xiel |
謝謝樓主了! |
謝謝 |
學習了,多謝 |
謝謝了 |