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控制DS26528和DS26524的發送脈沖

發布時間:2010-6-12 12:01    發布者:zealot
關鍵詞: DS26524 , DS26528 , 發送脈沖
當需要增加網絡保護元件,或需要通過連接器和其它PC板路由信號時,常常需要調整發送信號波形。DS26528和DS26524能夠對輸出脈沖進行細小的或重要的調整。本應用筆記介紹了訪問工廠測試寄存器、調整發送信號波形的方法,以滿足多種應用需求。
T1和E1發送波形的可編程段

通過DS26528和DS26524的內部寄存器,可以對發送脈沖的兩個主要屬性進行控制:幅度和定時。T1和E1發送脈沖分為幾段,每段都可以單獨控制,以提供所要求的信號波形。圖1顯示了T1脈沖的分段,以及控制每一段的寄存器。圖2為E1脈沖的類似信息。

T1和E發送波形的幅度控制

控制DS26528和DS26524發送脈沖幅度的方式有以下兩種:

調整DAC增益

利用L1TXLAE寄存器的DAC[3:0]位可同時對T1或E1電平進行正向和負向調整。

局部波形電平調整

通過Level Adjustment寄存器中的WLA[3:0]位,可對波形的特定段進行微調。電平調整的步長與設置的DAC增益成比例。如果DAC增益提高10%,則步長也相應增加10%。

T1和E1發送波形計定時控制

DS26528和DS26524發送脈沖的定時由Level Adjustment寄存器的CEA[2:0]位控制,可以正向或負向調整各個邊沿,增量為TCLK的1/32。

一般性建議

調整DAC增益是控制發送脈沖幅度的最簡單方法,因為只修改一個寄存器便可以控制整個波形。在進行波形調整時首先調整DAC增益,然后再調整各個獨立的Level Adjustment寄存器(如果需要的話),以獲得滿足要求的波形,這樣可以使總的調整步驟最少。

DAC的最大輸出將受VDD的影響,VDD較低時,也許很難達到最大DAC增益設置。改變VDD也會影響線驅動器輸出級的最大電壓

負值不用帶符號的整數表示,MSB是標志位,LSB代表幅度,與符號無關。例如,-3在WLA[3:0]寄存器中表示為1011b (第3位為1代表負數,接下來三位011是數值大小:3),而不是1101b (4位帶符號整數)。



T1脈沖分段控制

過沖(1) -- 寄存器L1TXLAA WLA[4:0]
時鐘沿(1CE) -- 寄存器L1TXLAA CEA[2:0]

(1CE) = 從過沖至平臺的時鐘沿跳變
平臺(2) -- 寄存器L1TXLAB WLA[4:0]

時鐘沿(2CE) -- 寄存器L1TXLAB CEA[2:0]
(2CE) = 從平臺至下降沿時鐘沿跳變

下沖(3) -- 寄存器L1TXLAC WLA[4:0]
時鐘沿(3CE) -- 寄存器L1TXLAC CEA[2:0]]

(3CE) = 下降沿至下沖(3)結束的時鐘沿
下沖(4) -- 寄存器L1TXLAD WLA[4:0]

時鐘沿(4CE) -- 寄存器L1TXLAD CEA[2:0]
(4CE) = 下沖結束(3)至下沖恢復(4)的時鐘沿

下沖(5) -- 寄存器L1TXLAC WLA[4:0]


E1脈沖分段控制

過沖(1) -- 寄存器L1TXLAA WLA[4:0]
時鐘沿(1CE) -- 寄存器L1TXLAA CEA[2:0]
(1CE) = 過沖至平臺的時鐘沿
平臺(2) -- 寄存器L1TXLAB WLA[4:0]
時鐘沿(2CE) -- 寄存器L1TXLAB CEA[2:0]

(2CE) = 平臺至下降沿的時鐘沿跳變

注意:

EI模式中未用到寄存器L1TXAC、L1TXAD和L1TXAE。

DS26528和DS26524的LIU測試寄存器

表1提供了LIU 1的寄存器地址和說明,這些寄存器被復制為LIU 2至8;

表2提供所有LIU測試寄存器的地址。DS26524不包含LIU 5至8


LIU測試寄存器文件說明

下文給出了LIU 1的寄存器地址和說明。這些寄存器被復制為LIU 2 至8。所有LIU測試寄存器的地址參見表2。


第7位至第3位: 發送波形輸出電平1調整(WLA[4:0]),幅度從默認值±360mV開始調整。

第7位 = 符號位('1' 表示負)

第6位至第3位 = 數值(無符號)

例如: LSB步長為24mV

第2位至第0位: 時鐘沿調整(CEA[2:0]),時鐘沿從默認值移動±32x-clk。

<2> = 符號位('1' 表示負)

<1:0> = 時鐘沿移動32x-clk (無符號)


第7位至第3位: 發送波形輸出電平2調整(WLA[4:0]),幅度從默認值±360mV開始調整。

第7位 = 符號位('1' 表示負)

第6位至第3位 = 數值(無符號)

例如:LSB步長為24mV

第2位至第0位: 時鐘沿調整(CEA[2:0]),時鐘沿從默認值移動±32x-clk。

<2> = 符號位 ('1' 表示負)

<1:0> = 時鐘沿移動32x-clk (無符號)


第7位至第3位: 發送波形輸出電平3調整(WLA[4:0])。在±360mV范圍內調整默認幅度。

第7位 = 符號位('1' 表示負)

第6位至第3位 = 數值(無符號)

例如: LSB步長為24mV

第2至0: 時鐘沿調整(CEA[2:0])。時鐘沿從默認值移動±32x-clk。

<2> = 符號位('1' 表示負)

<1:0> = 時鐘沿移動32x-clk (無符號)


第7位至3: 發送波形輸出電平4調整(WLA[4:0]),幅度從默認值±360mV開始調整。

第7位 = 符號位('1' 表示負)

第6位至第3位 = 數值(無符號)

例如: LSB步長為24mV

第2至0: 時鐘沿調整(CEA[2:0])。時鐘沿從默認值移動±32x-clk。

<2> = 符號位('1' 表示負)

<1:0> = 時鐘沿移動32x-clk (無符號)


第7位至4: 發送波形輸出電平4調整(WLA[4:0]),幅度從默認值±360mV開始調整。

第7位 = 符號位('1' 表示負)

第6位至第4位 = 數值(無符號)

例如: LSB步長為24mV

第3位至第0位: DAC增益調整(DAC[3:0]),修改DAC增益的設置如下。



T1和E1發送波形數據

以下數據由DS26528DK得出,能夠代表DS26528和DS26524的預期結果。提供這些數據是為了作為一個參考,幫助設計者了解如何利用Level Adjustment寄存器控制T1和E1發送脈沖的幅度和定時,以及能夠控制的范圍。這些數據在室溫以及3.3V VDD條件下獲得。





















































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