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[提問] 求助，epm7256，做rst延時

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樓主
發表于 2013-7-21 18:08:42 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式
要求給第一個復位信號至處理器，然后再處理器啟動過程中，屏蔽復位信號，到30s時候，一切正常，我不是特別熟悉verilog，寫了一下，之后，發現quartus自己的仿真不正確，因為比較著急，求助下先

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