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Writing Testbenches using SystemVerilog

發(fā)布時間：2012-12-18 15:46    發(fā)布者：newlife
關(guān)鍵詞： SystemVerilog


《Writing Testbenches Using SystemVerilog》Springer 2005年9月出版。作者為VMM的第一作者。

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rinllow6 發(fā)表于 2012-12-20 14:53:35
謝謝！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！
rinllow6 發(fā)表于 2012-12-20 13:07:41

    謝謝！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！！
jimcmwang 發(fā)表于 2014-10-29 09:15:59
《Writing Testbenches Using SystemVerilog》Springer 2005年9月出版。作者為VMM的第一作者
bruceyeh 發(fā)表于 2017-3-7 13:58:28
謝謝
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