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在用VHDL做一個(gè)課程設(shè)計(jì)，頂層文件出現(xiàn)一個(gè)小問題~誰來幫我看看 謝謝啦

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發(fā)布時(shí)間: 2013-6-8 02:03

正文摘要:

基于VHDL語言的電子琴設(shè)計(jì) 我分為4個(gè)模塊，前3個(gè)小模塊都沒問題，頂層模塊 編譯的時(shí)候出現(xiàn)錯(cuò)誤

回復(fù)

科瑞特 發(fā)表于 2013-7-24 11:18:10
引腳分配有問題。
yanhao_xj 發(fā)表于 2013-7-9 13:04:15
呵呵 ，等待答復(fù)
hch 發(fā)表于 2013-7-11 09:49:42
可能是pin腳分配有問題吧！
先把FPGA中的 Pin的分配 都 刪掉，再看一下，能否編譯；
這個(gè)最好也該一下:頂層文件中的 COMPONENT AUTO 有四個(gè)端口(port),而模塊中的 ENTITY AUTO 有五個(gè)端口(port)!
xiaoyuchidayu 發(fā)表于 2013-6-8 02:04:01
各位大神 幫幫忙
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