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標(biāo)題: FPGA開發(fā)疑問 [打印本頁]
作者: hedensen    時間: 2011-11-11 09:29
標(biāo)題: FPGA開發(fā)疑問
新手問個問題：
     偶現(xiàn)在是學(xué)生，感覺直接用VHDL和Veriog寫代碼好麻煩，如果要實現(xiàn)一些功能復(fù)雜的項目，感覺要費很大時間。剛看了System Generator，可以直接搭模塊然后轉(zhuǎn)換硬件語言，貌似簡單好多。想問外面公司，一般是怎么實現(xiàn)結(jié)構(gòu)化模塊設(shè)計的啊，也是一點點敲代碼么，有用System Generator直接設(shè)計產(chǎn)品的么
作者: freeboy898    時間: 2011-11-16 09:33
System Generator,沒用過，等高手指點一下...
作者: asyou    時間: 2011-11-16 15:16
部分通用的東西用IP，其它的自己寫！
作者: 我與阿Q同鄉(xiāng)    時間: 2011-11-17 16:28
是啊，通用的東西用IP，其他的用verilog寫
作者: braveboys    時間: 2012-2-20 18:43
可以選擇現(xiàn)有的IP core



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