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標題: 如何理解CPLD宏單元中的"共享乘積項"？ [打印本頁]

作者: xjb37 時間: 2011-8-7 11:13
標題: 如何理解CPLD宏單元中的"共享乘積項"？
altera的max7000系列CPLD。
看了很多教材和參考，就只有介紹"共享乘積項"。沒有具體的應用"共享乘積項"的例子。如下：
1）共享擴展項
　　每個 LAB 有 16 個共享擴展項。共享擴展項就是由每個宏單元提供一個未使用的乘積項，并將它們反相后反饋到邏輯陣列，便于集中使用。每個共享擴展乘積項可被 LAB 內任何 ( 或全部 ) 宏單元使用和共享，以實現復雜的邏輯函數。采用共享擴展項后會增加一個短的延時。
誰能給我舉一個使用"共享乘積項"的例子，或者是解釋一下，為什么通過乘積項共享就能夠"實現復雜的邏輯函數"？十分感謝！
給出共享乘積項結構圖片。

作者: McuPlayer 時間: 2011-8-13 01:23
CPLD之所以比FPGA可控性好，是因為其結構是基于與陣列和乘積項陣列的。
隨著工藝的發展，CPLD有了更多的宏單元，以完成邏輯功能，在一定程度上替代FPGA

CPLD對乘積項的使用，是比較浪費的，當然也獲取了可預估的延時等優點
為了提高效率，就把乘積項的資源用在宏單元上
但是，需要它的時候，它又搖身一變，成了乘積項

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