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標題:
vhdl coding and logic synthesis with synopsys
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作者:
cmmjava
時間:
2020-1-10 21:24
標題:
vhdl coding and logic synthesis with synopsys
1. 英文版《vhdl coding and logic synthesis with synopsys》
中文版 VHDL
--代碼編寫和基于
SYNOPSYS
工具的邏輯綜合
2 .PPT
Logic Synthesis with Synopsys
https://wenku.baidu.com/view/7c45ed0f7cd184254b353556.html
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