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標題:
verilog中寄存器大小
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作者:
codefpga
時間:
2017-11-17 09:32
標題:
verilog中寄存器大小
請問verilog中定義reg寄存器類型，有最大位寬限制嗎？
作者:
ddxx
時間:
2018-10-11 14:53
寬度是自己定義的，沒有限制
歡迎光臨 電子工程網 (http://m.qingdxww.cn/)
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