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標(biāo)題: SDRAM中的CAS latency指的是什么了？ [打印本頁(yè)]

作者: allokline 時(shí)間: 2009-9-14 16:06
標(biāo)題: SDRAM中的CAS latency指的是什么了？
1 看SDRAM的datasheet，不明白CAS latency指的是什么？
2 這里的pipeline該如何理解；
非常感謝大蝦們的指教

作者: wangkj 時(shí)間: 2009-9-14 17:16
在前面部分的文章中我們對(duì)于SDRAM的讀取過程進(jìn)行了詳細(xì)的討論，不過今天我發(fā)現(xiàn)在其中有個(gè)比較重要的重要的概念并沒有單獨(dú)的提出來(lái)講解一下，但是前面對(duì)于SDRAM讀取過程的講解中如果仔細(xì)領(lǐng)會(huì)也應(yīng)該對(duì)于CAS的概念比較了解了。在本章節(jié)的開始我們還是對(duì)于這個(gè)問題進(jìn)行一下專門的討論吧。 SDRAM CAS延遲如果你的主板支持對(duì)于內(nèi)存進(jìn)行比較全面的控制，那么你應(yīng)該在其中看到有關(guān)于CAS的選項(xiàng)，一般的可以選擇CAS 1、CAS 2或者CAS 3。你選擇不同的CAS值取決于你想要內(nèi)存在什么樣子的頻率上運(yùn)行。在本章節(jié)中主要就是告訴CAS latency值對(duì)于計(jì)算機(jī)系統(tǒng)究竟意味著什么以及為什么它們同總線速度有關(guān)。 CAS延遲（CAS latency）指的就是在READ命令觸發(fā)到第一次數(shù)據(jù)輸出之間的時(shí)間，這個(gè)時(shí)間的單位是以時(shí)鐘周期。這個(gè)延遲時(shí)間可以設(shè)定為1、2、3個(gè)時(shí)鐘周期。也就是說(shuō)，如果READ命令在第n個(gè)時(shí)鐘上升沿被觸發(fā)，延遲時(shí)間為m個(gè)時(shí)鐘周期，那么數(shù)據(jù)將會(huì)在第n＋m個(gè)時(shí)鐘上升沿開始輸出。下面的圖表（圖片都是來(lái)自 Micron的數(shù)據(jù)庫(kù)中關(guān)于MT48LC4M4A1的資料）可以幫助你更好的了解這個(gè)問題：　

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