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電子工程網(wǎng)

標(biāo)題: allegro15.5導(dǎo)入網(wǎng)表報(bào)錯(cuò) [打印本頁]

作者: anfaye 時(shí)間: 2009-8-10 19:44
標(biāo)題: allegro15.5導(dǎo)入網(wǎng)表報(bào)錯(cuò)
本帖最后由 anfaye 于 2009-8-10 19:53 編輯

我在導(dǎo)入原理圖生成的網(wǎng)表的時(shí),提示了這個(gè)錯(cuò)誤,說有2個(gè)錯(cuò)誤,不過不知道什麼錯(cuò)誤?老大們幫忙啊,看不懂什麼地方有問題了

#2 ERROR(102) Run stopped because errors were detected
netrev run on Aug 10 19:39:09 2009
COMPILE 'logic'
CHECK_PIN_NAMES OFF
CROSS_REFERENCE OFF
FEEDBACK OFF
INCREMENTAL OFF
INTERFACE_TYPE PHYSICAL
MAX_ERRORS 500
MERGE_MINIMUM 5
NET_NAME_CHARS '#%&()*+-./:=>?@[]^_`|'
NET_NAME_LENGTH 24
OVERSIGHTS ON
REPLACE_CHECK OFF
SINGLE_NODE_NETS ON
SPLIT_MINIMUM 0
SUPPRESS 20
WARNINGS ON
  2 errors detected
No oversight detected
No warning detected
cpu time    0:00:35
elapsed time  0:00:00

作者: carthy 時(shí)間: 2010-6-12 23:55
樓主導(dǎo)一個(gè)空的PCB試試

作者: pcbkey 時(shí)間: 2015-2-4 17:55
支持一下

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